發(fā)布時(shí)間：2018-06-10 16:04

  本文選題：SATA + 3.0　； 參考：《南京郵電大學(xué)》2017年碩士論文

【摘要】：信息技術(shù)的發(fā)展離不開存儲(chǔ)技術(shù)的助力,因此對存儲(chǔ)系統(tǒng)的研究具有相當(dāng)?shù)膽?yīng)用價(jià)值。本次課題旨在在FPGA平臺(tái)上利用SATA3.0接口設(shè)計(jì)實(shí)現(xiàn)一個(gè)高速大容量存儲(chǔ)系統(tǒng),主要的工作是研究并實(shí)現(xiàn)SATA3.0讀寫控制器的關(guān)鍵技術(shù)。SATA是一種高速串行總線協(xié)議,因其采用兩對差分線分別進(jìn)行串行發(fā)送和接收,能夠有效地避免總線干擾,故而取代PATA成為新一代的傳輸接口。SATA憑借其傳輸速率高、糾錯(cuò)能力強(qiáng)、支持熱插拔等特點(diǎn)而得到了廣泛的應(yīng)用,SATA3.0接口的最高傳輸速率更是達(dá)到了600MB/s,因此適用于高速大容量存儲(chǔ)系統(tǒng)的設(shè)計(jì)。本文首先介紹了SATA3.0協(xié)議的四層結(jié)構(gòu):物理層、鏈路層、傳輸層和應(yīng)用層,并對每一層的功能以及主要的功能模塊進(jìn)行介紹。然后利用Quartus II設(shè)計(jì)平臺(tái)并采用了自底向上的模塊化設(shè)計(jì)方法,分別設(shè)計(jì)實(shí)現(xiàn)了SATA3.0協(xié)議物理層收發(fā)器的配置,鏈路層擾碼模塊和CRC校驗(yàn)?zāi)�塊的設(shè)計(jì)以及傳輸層封裝模塊的設(shè)計(jì)。在本文的最后,分別給出了軟件仿真和板級(jí)測試的結(jié)果。首先利用Modelsim仿真軟件分別對設(shè)計(jì)的各個(gè)模塊進(jìn)行功能性的仿真驗(yàn)證,仿真結(jié)果表明各個(gè)模塊都能實(shí)現(xiàn)各自的邏輯功能。最后對整個(gè)系統(tǒng)進(jìn)行的讀寫測試表明系統(tǒng)能夠正確地進(jìn)行讀寫并且性能基本滿足SATA3.0協(xié)議要求。
[Abstract]:The development of information technology can not do without the help of storage technology, so the research of storage system has considerable application value. The purpose of this project is to design and implement a high speed and large capacity storage system on FPGA platform using SATA3.0 interface. The main work is to study and implement the key technology of SATA3.0 read and write controller. SATA is a high speed serial bus protocol. Because two pairs of differential lines are used for serial transmission and reception, which can effectively avoid bus interference, PATA is replaced as a new generation of transmission interface. SATA has high transmission rate and strong error correction ability. It has been widely used in the design of high speed and large capacity storage system because of its characteristics such as hot swapping and so on. The maximum transmission rate of SATA3.0 interface is 600MB / s, so it is suitable for the design of high speed and large capacity storage system. This paper first introduces the four layers of SATA3.0: physical layer, link layer, transport layer and application layer, and introduces the functions of each layer and the main function modules. Then, using Quartus II design platform and adopting bottom-up modularization design method, the configuration of physical layer transceiver of SATA3.0 protocol, the design of link layer scrambling code module and CRC check module and the design of transmission layer encapsulation module are designed respectively. At the end of this paper, the results of software simulation and board-level test are given respectively. Firstly, the function of each module is verified by Modelsim simulation software. The simulation results show that each module can realize its own logic function. Finally, the reading and writing test of the whole system shows that the system can read and write correctly and the performance basically meets the requirements of SATA 3.0 protocol.
【學(xué)位授予單位】：南京郵電大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2017
【分類號(hào)】：TP333

【參考文獻(xiàn)】

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本文編號(hào)：2003792