發(fā)布時(shí)間：2021-01-09 06:58

　　隨著現(xiàn)代社會(huì)的發(fā)展,計(jì)算機(jī)網(wǎng)絡(luò)技術(shù)、通信技術(shù)、視頻監(jiān)控等技術(shù)都得到了廣泛的應(yīng)用。在視頻監(jiān)控領(lǐng)域,由于自身的局限性,傳統(tǒng)計(jì)算機(jī)和視頻卡的技術(shù)方案已經(jīng)不能滿足很多場(chǎng)合的應(yīng)用需求,因此,新的網(wǎng)絡(luò)視頻監(jiān)控方案應(yīng)運(yùn)而生。嵌入式視頻網(wǎng)絡(luò)轉(zhuǎn)換卡以其體積小巧、功耗低、成本低等優(yōu)勢(shì),已成為網(wǎng)絡(luò)視頻監(jiān)控領(lǐng)域的趨勢(shì),具備廣闊的市場(chǎng)前景。本文在廣泛調(diào)研、分析、總結(jié)前人研究成果的基礎(chǔ)上,以無損視頻信號(hào)高速傳輸作為研究背景,經(jīng)過多種方案的對(duì)比,設(shè)計(jì)了適用于無損視頻信號(hào)高速傳輸?shù)那д拙W(wǎng)卡轉(zhuǎn)換系統(tǒng)方案。該方案采用當(dāng)下流行的SOPC技術(shù)和嵌入式千兆網(wǎng)技術(shù),為了使視頻數(shù)據(jù)無損高速傳輸,在硬件上選用Altera公司Cyclone III FPGA芯片、AXIS公司AX88180千兆MAC芯片和Realtek公司RTL8211千兆PHY芯片作為核心部件,構(gòu)建千兆網(wǎng)絡(luò)平臺(tái),使視頻數(shù)據(jù)不進(jìn)行任何壓縮即可傳輸,從而達(dá)到無損的目的;在軟件上選用開源嵌入式網(wǎng)絡(luò)協(xié)議棧LwIP作為網(wǎng)絡(luò)傳輸?shù)幕�礎(chǔ),為了解決網(wǎng)絡(luò)協(xié)議在嵌入式系統(tǒng)上效率較低的問題,結(jié)合硬件平臺(tái)和MAC驅(qū)動(dòng),對(duì)網(wǎng)絡(luò)協(xié)議棧進(jìn)行了優(yōu)化。本文還提出了針對(duì)該系統(tǒng)的系統(tǒng)測(cè)試方案,對(duì)系統(tǒng)的功... 

【文章來源】：華中科技大學(xué)湖北省 211工程院校 985工程院校 教育部直屬院校

【文章頁數(shù)】：65 頁

【學(xué)位級(jí)別】：碩士

【部分圖文】：

NiosII處理器典型結(jié)構(gòu)

10，數(shù)據(jù)轉(zhuǎn)換的部分包括 CameraLink[17][18]信號(hào)的均衡的數(shù)據(jù)進(jìn)行緩沖，F(xiàn)PGA 上 Nios 軟核，在其上實(shí)現(xiàn)采用千兆網(wǎng)絡(luò)控制芯片，PHY 層采用千兆網(wǎng)絡(luò)芯片實(shí)軟件，對(duì)圖像進(jìn)行顯示和控制。上圖框中為本系統(tǒng)，數(shù)據(jù)流向如圖 3-2 所示：

圖 3-3 PHY 層結(jié)構(gòu)框圖PHY 芯片輸入時(shí)鐘為 25MHz，與 MAC 層的數(shù)據(jù)接口為 RGMII 接口，向 M 125MHz 時(shí)鐘，通過 MDC 和 MDIO 與 MAC 進(jìn)行管理數(shù)據(jù)交互。 SOPC 系統(tǒng)設(shè)計(jì)片上系統(tǒng)（SoC，System on a Chip）是指將微處理器、模擬 IP 核、數(shù)字 IP 器（或片外存儲(chǔ)控制接口）集成在單一芯片上的系統(tǒng)，這是一個(gè) ASIC 設(shè)計(jì)FPGA 生產(chǎn)上借用這個(gè)概念，結(jié)合 FPGA 的可編程特性，提出片上可編程OPC，System on a Programmable Chip）的概念，也就是將微處理器、數(shù)字 I儲(chǔ)器（或片外存儲(chǔ)控制接口）集成在單一 FPGA 上的系統(tǒng)。該方案采用了 SOPC 這一設(shè)計(jì)理念，將大量的數(shù)字邏輯集合到了 FPGA 內(nèi)大簡(jiǎn)化了板級(jí)設(shè)計(jì)的復(fù)雜度。方案中使用了 Altera 公司生產(chǎn)的 CycloneIII GA，結(jié)合 Altera 公司提供的片上可編程系統(tǒng)定制工具 SOPC Builder，能夠很

【參考文獻(xiàn)】：
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