發(fā)布時(shí)間：2020-12-11 07:09

　　由高級(jí)語言編寫的程序,通過相應(yīng)的某種編譯器,根據(jù)相應(yīng)的指令集架構(gòu),可以被翻譯成能被相應(yīng)的處理器實(shí)現(xiàn)（Implementation）所識(shí)別的指令。如今我們所能見到的處理器基本上都采用了x86與ARM這兩種指令集架構(gòu),漫長(zhǎng)的發(fā)展過程使這兩種架構(gòu)足夠成熟,也使得它們難以避免地出現(xiàn)許多問題。不少設(shè)計(jì)者對(duì)x86與ARM架構(gòu)那過于復(fù)雜的指令集、昂貴的商業(yè)授權(quán)和難以獲取的源碼頗有微詞,在這樣的情況下,全新的指令集架構(gòu)RISC-V逐漸吸引了設(shè)計(jì)者們的注意。RISC-V提供了免費(fèi)開源、開發(fā)周期較短的處理器實(shí)現(xiàn)方案。面對(duì)國(guó)外芯片的生態(tài)和專利壁壘,RISC-V有望成為我國(guó)自主研制處理器芯片的一個(gè)極好的選擇。本次設(shè)計(jì)主要通過對(duì)RISC-V官方提供的參考處理器實(shí)現(xiàn)項(xiàng)目Rocket Chip的研究,構(gòu)建了基于RISC-V的SoC,首先對(duì)基于Rocket Chip的SoC的前端設(shè)計(jì)進(jìn)行了研究,基于0.13μm工藝,通過邏輯綜合和后端物理設(shè)計(jì)完成了SoC的物理實(shí)現(xiàn),然后由Rocket Chip生成的軟件模擬器初步對(duì)SoC的功能進(jìn)行仿真,基于Xilinx ARTY A7開發(fā)板,將構(gòu)建得到的SoC用FPGA實(shí)現(xiàn),并對(duì)其進(jìn)... 

【文章來源】：電子科技大學(xué)四川省 211工程院校 985工程院校 教育部直屬院校

【文章頁(yè)數(shù)】：71 頁(yè)

【學(xué)位級(jí)別】：碩士

【部分圖文】：

Rocket Chip生成器的構(gòu)成[14]

利用RISC-V交叉編譯工具riscv64-unknown-elf-gcc編譯該程序,生成對(duì)應(yīng)的可執(zhí)行文件test,再利用Spike執(zhí)行該文件,輸出結(jié)果如圖2-2所示,顯示了正確的計(jì)算結(jié)果,所搭建的RISC-V交叉編譯工具鏈可以正常工作。至此,RISC-V交叉編譯工具鏈搭建順利完成。

定義好類后,我們用關(guān)鍵詞new將test類實(shí)例化,這樣就可以去訪問類中的變量和操作。參數(shù)max的值為100,如圖2-3所示,可以看到1至100累加求和的結(jié)果顯示在標(biāo)準(zhǔn)輸出,為5050。我們也可以通過函數(shù)(Function)來實(shí)現(xiàn)以上的功能,比如:

【參考文獻(xiàn)】：
期刊論文
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本文編號(hào)：2910105